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esame architettura internet, Prove d'esame di Architettura Dei Calcolatori

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Tipologia: Prove d'esame

2020/2021

Caricato il 03/12/2021

arianna-castorina
arianna-castorina 🇮🇹

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NELLA PARTE DEL CIRCUITO DELLA CPU MIPS IN FIGURA CHE IMPLEMENTA L'ISTRUZIONE
DI SALTO CONDIZIONATO SU UGUAGLIANZA BEQ, IL MULTIPLEXER CONTROLLATO DAL
SEGNALE ALUSRC EFFETTUA LA SELEZIONE: In base al valore AluSrc=0, che instrada come
operando dell'ALU il valore Dato letto 2 contenuto nel Registro di indirizzo Istruzione[20-
16] letto in anticipo
NEL FLIP-FLOP SR L'INPUT S=1 ED R=1 DETERMINA: Nessuna transizione perché è una
configurazione input esclusa
pf2

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NELLA PARTE DEL CIRCUITO DELLA CPU MIPS IN FIGURA CHE IMPLEMENTA L'ISTRUZIONE

DI SALTO CONDIZIONATO SU UGUAGLIANZA BEQ, IL MULTIPLEXER CONTROLLATO DAL

SEGNALE ALUSRC EFFETTUA LA SELEZIONE: In base al valore AluSrc=0, che instrada come operando dell'ALU il valore Dato letto 2 contenuto nel Registro di indirizzo Istruzione[20- 16] letto in anticipo NEL FLIP-FLOP SR L'INPUT S=1 ED R=1 DETERMINA: Nessuna transizione perché è una configurazione input esclusa

NEL CIRCUITO DI LETTURA IN FIGURA IL CONTENUTO DEI REGISTRI DEL PROCESSORE MIPS È COLLEGATO: Ai terminali input del multiplexer relativi ai dati da selezionare utilizzando i valori sui terminali input di controllo del multiplexer costituiti dall'indirizzo del Registro