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Una panoramica sulla CPU, il ciclo macchina, l'architettura della CPU, l'assembler e le architetture RISC e CISC. Vengono inoltre forniti esempi di processori e le relative specifiche. Il testo è utile per gli studenti di informatica e ingegneria che vogliono approfondire le tematiche presentate.
Tipologia: Slide
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Prof. Marco Pizzamiglio
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Il Central Processing Unit svolge due funzioni:
● sovrintende: genera segnali necessari al funzionamento ● esegue: dei calcoli aritmetici e logici
La CPU è formata da:
● CU (Control Unit) ● ALU (Arithmetic Logic Unit) ● Registri di memoria
La CPU preleva dalla memoria il codice macchina dell’istruzione da eseguire (CU), inviata in un registro specifico e codificata. Dopo la codifica la CPU emette i segnali necessari per eseguire l’istruzione.
Ogni ciclo macchina è scandito da un temporizzatore o clock
● Fetch dell’istruzione ● Decode dell’istruzione ● Fetch degli operandi ● Execute
Alla fine del ciclo il sistema manda un segnale di reset
Fase in cui la CPU deve reperire l’istruzione da eseguire.
La CU legge la cella di memoria il cui indirizzo è memorizzato in un’ apposito registro chiamato contatore del programma (PC Program Counter), incrementandolo di una posizione.
In base all’istruzione il processore riconosce se è necessario prelevare da memoria o da registri.
● CU (Control Unit) ● PC (Program Counter) ● IR (Instruction register) ● PSW (Process Status Word)
Dispositivo che permette di collegare ogni elemento che compone la CPU
Celle di memoria contenute all’interno della CPU. La dimensione dei registri si esprime in bit.
● Registri accessibili al programmatore ● Registri non accessibili al programmatore
Diversamente dalle celle di memoria, i registri non hanno un’ indirizzo ma un nome
Registro interno collegato al BUS Indirizzi.
Non visibile al programmatore e contiene gli indirizzi necessari alla scelta della cella di memoria oppure al dispositivo di I/O coinvolto nell’operazione.
Registro interno che riceve il codice operativo
Non visibile al programmatore.
Registro accessibile parzialmente dal programmatore e contiene l’indirizzo dell’istruzione successiva nella memoria.
Nelle architetture intel si definisce IP (Instruction Pointer)
Registro con tanti flag utilizzati per operazioni con la ALU.
● ZF: 1 se l’ultima operazione è uguale a