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Tablas de verdad, función, diagrama de tiempo
Tipo: Ejercicios
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Taller circuitos combinacionales
1. Realice el diseño (tabla de verdad, diagrama de tiempo, circuito combinacional, mapa de karnaugh) de los siguientes circuitos a) Un medio sumador de 4 bits de entrada. A B Sum Cout 0 0 0 0 0 1 1 0 1 0 1 0 1 1 0 1 Sum
Cout
d) Un demultiplexor de 1 a 4 I S1 S0 Y3 Y2 Y1 Y I 0 0 X X X Y I 0 1 X X Y1 X I 1 0 X Y2 X X I 1 1 Y3 X X X Y0 = IS1'S0' Y1 = IS1'S Y2 = IS1S0' Y3 = IS1S
e) Un codificador de 8 bits de entrada (Sin prioridad) EN I0 I1 I2 I3 I4 I5 I6 I7 A2 A1 A 1 X X X X X X X X 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 1 0 0 0 1 0 0 0 0 0 0 1 0 0 0 0 0 1 0 0 0 0 0 1 1
f) Un decodificador de 3 bits de entrada I2 I1 I0 A7 A6 A5 A4 A3 A2 A1 A 0 0 0 0 0 0 0 0 0 0 1 0 0 1 0 0 0 0 0 0 1 0 0 1 0 0 0 0 0 0 1 0 0 0 1 1 0 0 0 0 1 0 0 0 1 0 0 0 0 0 1 0 0 0 0 1 0 1 0 0 1 0 0 0 0 0 1 1 0 0 1 0 0 0 0 0 0 1 1 1 1 0 0 0 0 0 0 0 A0 = I0'I1'I2' A1 = I0I1'I2' A2 = I0'I1I2' A3 = I0I1I2' A4 = I0'I1'I A5 = I0I1'I A6 = I0'I1I A7 = I0I1I
g) Un generador de bit de paridad de 8 bits de entrada A1 A0 BP 0 0 0 0 1 1 1 0 1 1 1 0
3. Determine cuál es el camino de los datos y las palabras de control para el esquema anterior.
4. Para cada tabla de verdad obtenga la función lógica mediante mapas de Karnaugh
8. Determinar las salidas de un sumador completo para cada una de las siguientes
9. Un decodificador 74HC147 tiene niveles BAJOS de tensión en sus pines 2, 5 y 12. ¿Qué código BCD aparece en las salidas si todas las demás entradas están a nivel ALTO? Pin 2 → 5 LHHH → 0111 → 7 Pin 5 → 8 Pin 12 → 2 10. En el demultiplexor de la Figura, determinar la salida para los siguientes estados de entrada: D0 = 0, D1= 1, D2= 1, D3= 0, S0 = 1, S1 = 0 La salida es D
