Dispositivos Lógicos Programables
(PLDs)
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Sistemas Digitales II / Electronica Digital II
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Dispositivos Lógicos Programables (PLDs): SPLDs, CPLDs y FPGAs, Diapositivas de Electrotecnia
Este documento ofrece una introducción a los Dispositivos Lógicos Programables (PLDs), incluyendo Sistemas Programables Lógicos Simples (SPLDs), Sistemas Programables Lógicos Complejos (CPLDs) y Arreglos de Compuertas Programables en el Campo (FPGAs). El texto también aborda la evolución de estos dispositivos, una comparación entre ellos y la producción de PLDs. Además, se detalla la programación de CPLDs y sus diferentes opciones, como one-time programmable y borrable por UV o electricamente.
Tipo: Diapositivas
2011/2012
1 / 42
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Dispositivos Lógicos Programables
(PLDs)(PLDs) Sistemas Digitales II / Electronica Digital II
Dispositivos Logicos Programables (PLDs) • Dispositivos Programables Simples (SPLD)Di^ iti^ P
bl^
C^ l j^ (CPLD)
•^ Dispositivos Programmables Complejos (CPLD)•^ Arreglo de Compuertas Programables enArreglo de Compuertas Programables enCampo (Field Programmable Gate Arrays,FPGAs)FPGAs)
Sistemas Digitales II / Electronica Digital II
Dispositivos Lógicos Programables (PLDs) ^ Dispositivos Lógicos Programables Simples(SPLDs)(SPLDs) ^ Dispositivos Lógicos Programables Complejos^ (CPLDs) ^ Arreglo de Compuertas Programables en el^ Arreglo de Compuertas Programables en elCampo (Field Programmable Gate Arrays,FPGAs)FPGAs)
Sistemas Digitales II / Electronica Digital II
Cuadro Comparativo de los diferentes PLDs
Sistemas Digitales II / Electronica Digital II
Dispositivos Lógicos Programables Complejos
(CPLDs)(CPLDs) Sistemas Digitales II / Electronica Digital II
CPLDs
^ CPLDS contiene el equivalente de varios PALs/ GALsconnectados por interconnecciones programmables.p^
p^ g ^ CPLDs pueden reemplazar miles o cientos de milescompuertas lógicas.p^ g ^ El tiempo de E/S del CPLD es predecible debido a su simpleestructura de interconecciones ^ CPLDsti^ 16 1024
ld contiene 16-1024 macroceldas cada macrocelda equivale a unas 20/40 compuertas(incluyendo un Flip/Flop programable)(incluyendo un Flip/Flop programable) puede tener desde 20 hasta 381 I/Os hay un trade-off entre el espacio para las macroceldas y elespacio para las interconeccionesSistemas Digitales II / Electronica Digital II
Programación de los CPLDs (cont.) Borrable por UV^ ^ la programacion del CPLD es borrada por emisión UV^ la programacion del CPLD es borrada por emisión UV^ ^ tiene un encapsulado cerámico con una ventana arribadel área del chipdel área del chip^ ^ este encapsulado especial es bastante caro^ ^ normalmente se debe remover el CPLD del zócalo paraborrarlo/reprogramarlo^ ^ programación es retenida después de cortar Vcc (no-volatile)programación/borrado es limitada a unos 1000s ciclos^ programación/borrado
es limitada a unos 1000s ciclosSistemas Digitales II / Electronica Digital II
Programación de los CPLDs (cont.) Borrable electricamente^ ^ borrado y programado del CPLD se hace con unacorriente eléctrica^ ^ el CPLD puede ser programado/borrado en el PCB, noes necesario encapsulado especial o zócalo^ ^ tiempo de borrado es mucho menor que el borrado UV^ ^ no-volatile^ ^ programación/borrado es limitada a unos 1000s ciclos^ ^ Programación/borrado se lleva a cabo mediante la^ Programación/borrado se lleva a cabo mediante laconección del CPLD a una computadora (una PCcualquiera con un software del fabricante del CPLD).C^ l CPLD^
it^ d^ d l Como el CPLD no necesita ser sacado delsistema/plaqueta en que esta soldado, esto es conocidocomo In-System-Programmable (ISP)como In System Programmable (ISP).Sistemas Digitales II / Electronica Digital II
Xilinx XC9500 CPLD^ Sistemas Digitales II / Electronica Digital II
Xilinx XC9500 CPLD - Arquitectura^ Sistemas Digitales II / Electronica Digital II
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XC9500 – Matriz de Conecciones Fast Switch
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