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Tarea 4 Electronica Digital, Ejercicios de Electrónica Digital y Analógica

En este trabajo se desarrolla Circuitos secuenciales

Tipo: Ejercicios

2020/2021

Subido el 25/07/2021

zulay-rangel
zulay-rangel 🇨🇴

4.4

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Tarea 4: Circuitos Secuenciales
Presentado a:
Jairo Alberto Cuellar
Tutor
Presentado por:
Zulay Johana Rangel Rincón
Código: 1118555398
Grupo: 243004_8
Universidad Nacional Abierta y a Distancia UNAD
Escuela de Ciencias Básica Tecnología e Ingeniería
Curso Electrónica Digital
Envigado, 25 de julio de 2021
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Tarea 4: Circuitos Secuenciales Presentado a: Jairo Alberto Cuellar Tutor Presentado por: Zulay Johana Rangel Rincón Código: 1118555398 Grupo: 243004_ Universidad Nacional Abierta y a Distancia UNAD Escuela de Ciencias Básica Tecnología e Ingeniería Curso Electrónica Digital Envigado, 25 de julio de 2021

La actividad consiste en: Realizar el diseño a nivel de diagrama de bloques y la implementación en VHDL de los siguientes circuitos digitales. Ejercicios por resolver.

  1. Diseñe un flip-flop tipo D, con reset activo en alto y enable activo en alto. a. ¿Qué es un flip flop? b. Un diagrama de bloques y colocar la tabla de verdad. c. Una impresión de pantalla con la descripción en VHDL.
  1. Diseñe un registro de 8 bits con reset activo en alto. a. ¿Qué es un registro? Conjuntos de biestables que funcionan al unísono compartiendo sus señales de control. Normalmente se utilizan registros formados por biestables de tipo D, o bien con biestables S-R o J-K funcionando como biestables D. Los registros necesitan una señal de sincronismo por nivel (latch) o por flanco. A diferencia de los contadores no tiene una secuencia especifica de estados. Aplicaciones: almacenamiento y desplazamiento de datos. Tipos de Registro: b. Un diagrama de bloques, colocar la tabla de verdad. c. Una impresión de pantalla con la descripción en VHDL

d. Una impresión de pantalla con la simulación generada en EDA PLAYGROUND.

c. Una impresión de pantalla con la simulación , en el cual se evidencie el correcto funcionamiento del diseño.

  1. Diseñe un contador descendente módulo M, donde M es su edad. El diseño debe incluir:

a. Un diagrama de bloques diseñado por el estudiante. Como 2𝑛−1 es el máximo de cuenta, donde “n” es igual al número de bit, para este caso (si es mayor de 31 y menor a 63, para la cual se usan 8 bit), podemos usar 2𝑛−1 = 26= Para este punto usaremos 2 𝑛−1=28−1= b. Una impresión de pantalla con la descripción en VHDL c. Una impresión de pantalla con la simulación , en el cual se evidencie el correcto funcionamiento del diseño.

c. Una impresión de pantalla con la simulación, en el cual se evidencie el correcto funcionamiento del diseño. El conteo empieza en los 50 ns.

Al llegar a los 1200 ns, el conteo empieza a descender.