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simulacion cirvuitos, Esquemas y mapas conceptuales de Circuitos Digitales

simulaciones de ciercuitos en proteus lab 5

Tipo: Esquemas y mapas conceptuales

2022/2023

Subido el 01/11/2023

elio-churata
elio-churata 🇧🇴

2 documentos

1 / 13

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bg1
10
98
U1:C
74LS00
13
12 11
U1:D
74LS00
?
R1
330
R2
330
Salida Q
a)Circuito eliminador de rebotes SR
Elio Churata
1
23
U2:A
74HC00
4
56
U2:B
74HC00
C1
100uF
48%
RV1
100k
R3
10k
D1
LED-GREEN
R4
330
?
0
?
R11
330
R12
330
Simulacion Gal22v10
Elio Churata
I0/CLK
1
I1
2
I2
3
I3
4
I4
5
I5
6
I6
7
I7
8
I8
9
I9
10
I10
11
I11
13
IO0 23
IO1 22
IO2 21
IO3 20
IO4 19
IO5 18
IO6 17
IO7 16
IO8 15
IO9 14
U6
AM22V10
?
?
b) Oscilador astable con compuertas logicas
Elio Churata
A)CIRCUITOS GENERADORES DE RELOJ
pf3
pf4
pf5
pf8
pf9
pfa
pfd

Vista previa parcial del texto

¡Descarga simulacion cirvuitos y más Esquemas y mapas conceptuales en PDF de Circuitos Digitales solo en Docsity!

10 9 8

U1:C

74LS

13 12

11

U1:D

74LS

?

R

330

R

330

Salida Q

a)Circuito eliminador de rebotes SR

Elio Churata

1 2 3

U2:A

74HC

4 5 6

U2:B

74HC

C

100uF

48%

RV

100k

R

10k

D

LED-GREEN

R

330

?

0

?

R

330

R

330

Simulacion Gal22v

Elio Churata

(^1) I0/CLK (^23) I1I (^45) I3I (^67) I5I (^89) I7I (^1011) I9I (^13) I

IO0 23 IO1IO2 (^2221) IO3IO4 (^2019) IO5IO6 (^1817) IO7IO8 (^1615) IO9 14

U

AM22V

??

b) Oscilador astable con compuertas logicas

Elio Churata

A)CIRCUITOS GENERADORES DE RELOJ

4 R

DC 7

Q 3

GND

VCC

2 TR TH 6

5 CV

U

C

10nF

R

30k

R

680k

C

1nF

F=100Hz

R5(1)

4 R

DC 7

Q 3

GND

VCC

2 TR TH 6

5 CV

U

C

10nF

R

3k

R

68k

C

1nF

f=1kHz

R7(1)

4 R

DC 7

Q 3

GND

VCC

2 TR TH 6

5 CV

U

C

1nF

R

5.6k

R

150k

C

1nF

f=5kHz

R9(1)

C)Oscilador Astable Con el CI 555

Codigo en verylog

Codigo wincupl

II a

Codigo VHDL

2 D Q 5

3 CLK

Q 6

S^

R

U1:A

74LS

1

U2:A

74LS

U2:B

74LS

U2:C

74LS

D

Q (nor)

CLK

Q (CI)

1 I0/CLK

2 I

3 I

4 I

5 I

6 I

7 I

8 I

9 I

10 I

11 I

13 I

IO0 23

IO1 22

IO2 21

IO3 20

IO4 19

IO5 18

IO6 17

IO7 16

IO8 15

IO9 14

U

AM22V

Q Gal

  1. Flip Flop Asincrono

Elio Churata

U1A

7400N

U2B

7400N

U2A

7400N

U1B

7400N

0

j

Key = Space

1

k

Key = Space

Q

5V

NQ

5V

1

NJ

Key = Space

0

NK

Key = Space

NQ

5V

Q

5V

U5A

7402N

U5B

7402N

U5C

7402N

U5D

7402N

ii.b) FF jk Nand

ii.b) FF jk Nor

Elio Churata Elio Churata

U

NAND_

U

NAND_

U

NAND_

U

NAND

1

J

0

K

1

D LED-GREEN

D LED-GREEN

U

NAND_

U

NAND_

U

NAND_

U

NAND

0

CK

1

T

1

D LED-GREEN

D LED-GREEN

II flip Flop Asincrono

Elio Churata

a) JK sincrono a) T sincrono

U

NAND_

U

NAND

0

CK

1

D

1

D LED-GREEN

D LED-GREEN

Elio Churata

b) FF -D sincrono

0

C_K

U

NAND_

1

CK

1

D

1

CLR

D LED-GREEN

D LED-GREEN

Elio Churata

C) FF -D sincrono con PRE y CLR

U

NAND_

1

PRE

U

NAND

U

NAND

U

NAND

U

NAND

Codigo en Verylog

U

NAND_

U

NAND_

U

NAND_

U

NAND

1

J

1

K

Inicializador

V) MAESTRO ESCLAVO

Elio Churata

FF JK MAESTRO ESCLAVO

U

NAND_

1

CLR

D LED-GREEN

D LED-GREEN

U

NAND_

1

PRE

U

NAND

U

NAND

Elio Churata

U

AND

U

AND

U

NOT

0

CK

U

NAND_

U

NAND_

U

NAND_

U

NAND

1

T

U10(D2)

Elio Churata

FF T MAESTRO ESCLAVO

U

NAND_

1

CLR

D LED-GREEN

D LED-GREEN

U

NAND_

0

PRE

U

NAND

U

NAND

Elio Churata

U

AND

U

AND

U

NOT

0

CK

Código en vhdl

2 D Q 5

3 CLK

Q 6

S

R^

1 U1:A

74S

U

AND

U

OR

1

1

0

1

J

1

Q

0

K

12 D Q 9

11 CLK

Q 8

S^

R

U1:B

1^ 74S

1

0

0

Q

U

XOR

0

T

U

NOT

U

AND

VI) APORTE DEL ALUMNO

Elio Churata

Elio Churata