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Material descritivo e usual para entendimento de contadores síncronos.
Tipologia: Notas de estudo
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DEFINIÇÃO: São contadores que, para evitar o efeito do atraso na comutação das saídas dos contadores assíncronos, tem o clock aplicado simultaneamente em todos os flip-flops.
Solução proposta:
ANÁLISE: Para que o circuito anterior gere a seqüência desejada será necessário implementar um circuito combinacional que, baseado no estado atual, gere nas entradas dos flip-flops os sinais necessários para a geração do estado futuro desejado.
EXERCÍCIO: Projetar um contador módulo 5 crescente usando flip-flops JK.
Estado Atual
Estado Futuro
Sinais Necessários
Q2 Q1 Q0 Q2 Q1 Q0 J2 K2 J1 K1 J0 K 0 0 0 0 0 1 0 0 1 0 1 0 0 1 0 0 1 1 0 1 1 1 0 0 1 0 0 0 0 0
EXERCÍCIO: Apresente o diagrama de estados do circuito síncrono abaixo. Considere como estado inicial Q1Q0=„00‟
EXERCÍCIO: Contador módulo 5 crescente usando flip-flops JK.
EXERCÍCIO: Projetar um circuito síncrono que forneça o diagrama de estados “ideal” anterior.
EXERCÍCIOS:
Máquinas Síncronas com entradas.
Exemplo: Projetar um contador síncrono módulo 4, progressivo e regressivo, controlado por uma chave:
Diagrama de Estados:
Exemplo: Projetar um contador síncrono módulo 4, progressivo e regressivo, controlado por uma chave:
Estado Atual
Estado Seguinte M=0 M= Q1 Q0 Q1 Q0 Q1 Q 0 0 0 1 1 0 1 1
Máquinas Síncronas com entrada(s) e saída(s) combinatória(s):
Exemplo: Projetar um sistema que tenha uma única entrada X e uma única saída Z. X será uma entrada síncrona, de modo que cada vez que um dado válido for aplicado um clock deverá acontecer. Caso para estudo: o sistema deverá apresentar as saída Z em “ 1 ” apenas quando X for “ 1 ” durante 3 ou mais clocks.
Considere a seguinte arquitetura:
Exemplo: Projetar um sistema que tenha uma única entrada X e uma única saída Z. X será uma entrada síncrona, de modo que cada vez que um dado válido for aplicado um clock deverá acontecer. Caso para estudo: o sistema deverá apresentar as saída Z em “ 1 ” apenas quando X for “ 1 ” durante 3 ou mais clocks.
Análise de uma sequência de entrada:
Ciclo de
Clock
